臺灣博碩士論文加值系統

本篇論文以提高液晶顯示器的色彩飽和度與Gamma校正為前提，設計一個分段式線性十二位元數位類比轉換器。此資料轉換是由八位元電阻串式數位類比轉換器(R-DAC)加上四位元電荷共享式數位類比轉換器(C-DAC)所組成，分別地使用在高位元與低位元的資料轉換。利用分段式線性補償可減少晶片的面積也可增加色彩的濃度，此外也可以加入Gamma校正來修正液晶穿透率對外加資料電壓特性呈線性關係。電路上使用了摺疊疊接式運算放大器搭配Class AB所構成的輸出級，可實現高頻率響應與低靜態功率消耗的緩衝放大器。
本篇源極驅動器是用台積電0.35μm 2P4M CMOS製程設計，工作電壓為5V，資料轉換安定時間也在3.5 μs內，單一通道的緩衝放大器靜態偏壓電流為6.64 μA，兩個通道的晶片佈局面積為865μm × 1250μm (不包含PAD)。

This thesis is to improve liquid crystal displays for color saturation and Gamma correction, and a piecewise linear 12-bit segmented digital-to-analog converter (DAC) for LCD source driver is proposed. The data conversion is carried out by an 8-bit resistor-string type DAC (R-DAC) and a 4-bit charge sharing DAC (C-DAC), which are used for the most significant bit and least significant bit data conversions, respectively. Piecewise linear compensation is utilized to reduce the die area and increase the effective color depth. In addition, Gamma correction can be applied to amend the characteristic of the liquid crystal transmittance-to-voltage to be a linear relationship. A folded-cascade operational amplifier with a class AB output stage has been designed for high frequency response and low static power of the output buffer amplifier.
The proposed LCD source driver was simulated using TSMC 0.35μm 2P4M CMOS process model. The operation voltage is 5V and the settling time of data converter is within 3.5μs. The static bias current of buffer amplifier is 6.64μA for each channel. The layout area for 2 channels is 865μm × 1250μm (without I/O pads).

摘要 i
ABSTRACT ii
誌 謝 iii
目錄 iv
圖目錄 vii
表目錄 xiii
第一章 緒論 1
1.1 研究動機 1
1.2 論文架構 2
第二章 液晶顯示器系統介紹 4
2.1 液晶的介紹 4
2.1.1 液晶顯示器的顯示模式 5
2.1.2 液晶顯示器的分類 7
2.1.2.1 TN型液晶顯示器 7
2.1.2.2 STN型液晶顯示器 9
2.1.2.3 DSTN型液晶顯示器 9
2.1.2.4 TFT型液晶顯示器 10
2.1.3 液晶顯示器的驅動類型 12
2.1.3.1 主動式矩陣式驅動 12
2.1.3.2 被動式矩陣式驅動 13
2.1.4 TFT-LCD系統架構介紹 14
2.2 液晶顯示器的反轉法 16
2.3 液晶顯示器的迦瑪校正原理 17
2.3.1 迦瑪值 17
2.3.2 迦瑪校正 19
2.4 液晶顯示器源極驅動器簡介 21
2.4.1 液晶顯示器源極驅動器架構 21
2.4.2 電阻串分壓數位類比轉換器 22
2.4.3 R-2R數位類比轉換器 24
2.4.4 適用於電阻串數位類比轉換器的佈局法 25
第三章 數位類比轉換器設計 30
3.1 數位類比轉換器架構設計 30
3.1.1 分段式架構 31
3.1.2 分段式數位類比轉換器設計 32
3.2 電阻串數位類比轉換器設計 32
3.3 電荷共享式數位類比轉換器設計 35
3.4 摺疊疊接式運算放大器設計 36
3.5 多工器設計 36
第四章 模擬結果 39
4.1 電阻串數位類比轉換器模擬結果 39
4.2 電荷共享式數位類比轉換器模擬結果 45
4.3 摺疊疊接式運算放大器模擬結果 49
4.4 源極驅動器模擬結果 57
4.5 佈局後模擬結果 66
4.5.1 佈局後摺疊疊接式運算放大器模擬結果 67
4.5.2 佈局後源極驅動器模擬結果 75
第五章 結論 85
參考文獻 86

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