臺灣博碩士論文加值系統

　　本論文主要是以FPGA為核心控制器，發展一個影像擷取系統的硬體部分。影像擷取系統的硬體可以分為影像擷取模組、影像儲存模組與傳輸介面模組。
　　影像擷取模組是採用Philips所出的SAA7113H為A/D Converter，PIC16F877負責SAA7113H初始化動作設定。影像儲存模組是由Averlogic所生產的AL422B當作Frame Buffer，在這裡採用了兩顆Frame Buffer來儲存較高解析度的畫面資料。傳輸介面部分則是用Cypress EZ-USB FX2，利用這顆IC把所儲存的畫面資料傳回到電腦，以提供日後在電腦作影像相關處理用途。

　　The core of this thesis is to develop a hardware part of video capture system by using FPGA as a core controller. It could be divided into video capture module, video memory module and transmitter interface module.
　　In the video capture module, we use SAA7113H, which belongs to Philips to be A/D Converter, PIC16F877 for the set up initial value of SAA7113H respectively. In the video memory module, we use AL422B which belongs to Averlogic to be frame buffer, in which, we use two frame buffers to save high resolution video frame. The final, we utilize EZ-USB FX2 to be the transmitter interface chip in transmitter interface module, so we can use it to transfer the video frame to the computer. At afterward it is convenient to process image or video in computer.

第一章 緒論 1
1.1研究動機 1
1.2論文架構 1
第二章 原理基礎 2
2.1 NTSC原理 2
2.1.1 掃描與同步 2
2.1.2 視頻訊號 4
2.2 ITU656規格 6
2.3 YUV與RGB轉換 9
第三章 影像擷取模組 12
3.1 彩色CCD 12
3.2 Video decoder 13
3.2.1 類比輸入處理 14
3.2.2 色差處理 15
3.2.3 明視度處理 17
3.3 I2C傳輸介面 17
3.3.1 I2C傳輸協定 18
3.3.2 I2C模組設計 19
3.4 FVH模組與PL Counter模組 21
3.4.1 FPGA簡介 21
3.4.2 FVH模組 22
3.4.3 PL Counter模組 23
第四章 影像儲存模組 25
4.1 Frame Buffer 25
4.1.1 重置動作 26
4.1.2 寫入動作 27
4.1.3 讀出動作 27
4.2 Frame Buffer控制模組 30
4.2.1 寫入介面 30
4.2.2 讀取介面 32
第五章 USB傳輸介面 34
5.1 GPIF介面設計 36
5.2 使用者應用設定 40
5.3 Firmware Frameworks 44
第六章 模組測試 46
6.1 個別模組測試 46
6.2 硬體系統測試 50
第七章 結論與未來發展 52
參考文獻 53

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