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研究生:林諭棟
研究生(外文):Lin, Yu-Dong
論文名稱:一個2伏特2G赫茲的CMOS相鎖迴路
論文名稱(外文):A 2V 2 GHz CMOS PHASE-LOCKED LOOP
指導教授:吳介琮
指導教授(外文):Wu, Jie-Cong
學位類別:碩士
校院名稱:國立交通大學
系所名稱:電子研究所
學門:工程學門
學類:電資工程學類
論文種類:學術論文
論文出版年:1996
畢業學年度:84
語文別:中文
論文頁數:61
中文關鍵詞:電子工程相鎖迴路電壓控制振盪器多係數除頻器相頻偵測器電荷充式濾波器
外文關鍵詞:ELECTRONIC-ENGINEERINGPLLVCOMDIVPFDCPF
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本篇論文描述2伏特2G赫茲的CMOS相鎖迴路積體電路,它包含電壓控制振盪器(
VOLTAGE CONTROLED OSCILLATOR),多係數除頻器(MULTI-MODULUS DIVIDER),相
頻偵測器(PHASE-FREQUENCY DETECTOR),和電荷充式濾波器(CHARGE-PUMP FILTER
)。
電壓控制振盪器為負電阻電感電容的射頻振盪器,其振盪頻率是由可調式電容所控制
,輸出頻率從1.9GHz到2GHz。電流模式非同步係數除頻器可除頻倍數從128到256,共
32個除數。一個重新同步的電路是為了降低非同步除頻器從第一級到最後一級,因為
傳輸延遲所造成的相位雜訊而設計的,相頻偵測器比較輸入參考信號與除頻器除頻後
信號的相位及頻率差,輸出充電UP和放電DN的數位信號,電荷充式濾波器將相頻偵測
器的數位輸出,轉換成電壓控制振盪器所能接受的類比輸入訊號,以控制振盪器的輸
出頻率。本論文所有的數位電路是由改良型電流模式邏輯構成,以減小電壓源雜訊的
影響。
這個相鎖迴路是用0.6um SPDM CMOS的單晶製程製造,此積體電路包含pads所用面積
共3mm*3mm,當工作在電壓-2V且最大輸出頻率2GHz時,總消耗功率是154mW。

QRCODE
 
 
 
 
 
                                                                                                                                                                                                                                                                                                                                                                                                               
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