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研究生:薛敏琪
研究生(外文):Hsueh, Min-chi
論文名稱:混合型第三階數位多工機之韌體設計
論文名稱(外文):Firmware Design for MX3 Multiplexer
指導教授:吳國棟
指導教授(外文):Kou-Tan Wu
學位類別:碩士
校院名稱:國立中正大學
系所名稱:電機工程學系
學門:工程學門
學類:電資工程學類
論文種類:學術論文
論文出版年:1997
畢業學年度:85
語文別:中文
論文頁數:48
中文關鍵詞:多工機數位階層
外文關鍵詞:MultiplexerDigital Hierarchy
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混合型第三階數位多工機可將歐規及美規第一階數位訊號多工成美規第三
階數位訊號,以達到將多路低速訊號經由高速傳輸的目的。混合型第三階
數位多工機是一個多線路板系統,需要規劃一個整合各線路板的韌體架構
來達成系統的監控。每一部混合型第三階數位多工機都有一個系統控制單
體,面包含一顆MC68302,記憶體以及一顆用做輸出輸入阜的FPGA。而
各個傳輸單體及電源供應單體上皆包含一顆8051微處理器。系統的整合控
制是經由這些微處理器間的溝通來達成.在本篇論文中完成了系統控制單
元的硬體和韌體,傳輸單體及電源供應單體上的韌體,以及微處理器間的
溝通規約。

A multiplexer is used to achieve simultaneous transmission of
multiple low rate tributaries over a single high speed carrier.
The MX3 Multiplexer multiplexes 21 E1 or 28 DS1 signals into a
DS3 signal. The designed MX3 system is a multi-board
multiprocessor-based system. System firmware and board-level
firmware are needed to perform monitor and control functions for
the system.The system control unit (SCU) is equipped in each MX3
Multiplexer, which consists of MC68302 integrated multi-protocol
processor, memories and FPGA-implemented I/O ports. The 8051
microprocessor is equipped in each transmission-related units
and power units. The system management is achieved by the inter-
board communications among those microprocessors, i.e., MC68302
and 8051 microprocessors.The hardware design and the firmware of
the SCU, the firmware of the on-board 8051s and the inter-
processor communication protocol are developed and implemented
in this thesis.

QRCODE
 
 
 
 
 
                                                                                                                                                                                                                                                                                                                                                                                                               
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