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論文基本資料
摘要
外文摘要
目次
參考文獻
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研究生:
陳玟瑋
研究生(外文):
Chen Wen Wei
論文名稱:
以FPGA為基礎Reed-Solomoncode解碼器之實現
指導教授:
胡大湘
、
李勝義
學位類別:
碩士
校院名稱:
國防大學中正理工學院
系所名稱:
電子工程研究所
學門:
工程學門
學類:
電資工程學類
論文種類:
學術論文
論文出版年:
2006
畢業學年度:
94
語文別:
中文
論文頁數:
62
中文關鍵詞:
解碼器
外文關鍵詞:
Reed-Solomon code
相關次數:
被引用:0
點閱:295
評分:
下載:0
書目收藏:0
錯誤更正碼對於數位通訊而言,其重要性不言可喻,而RS Code更是目前被廣泛應用於數位通訊與儲存媒體中,做為錯誤更正碼之演算法應用,並更正通道所引起的錯誤。對於叢集錯誤(Bursty Error)與隨機錯誤(Random Error),RS Code可以提供極佳的錯誤更正能力,因此成為經常使用的通道編碼方式。
本論文著重在解碼器的部分,以修正過的歐基里德演算法(MEA, Modified Euclidean Algorithm)為基礎,並導入線性回饋位移暫存器(LFSR, Linear Feedback Shift Register)的概念:通常使用歐基里德演算法時,會利用最大公因素法,不斷地用遞迴方式找出商和餘數,大量的使用到乘除和加法運算而降低了運算速度,若使LFSR的架構,便可用除法電路來代替,且降低所需各運算器的數目以簡化電路。再加上去除Timing Control限制之方法,並佐以c語言程式驗證,最後用(VHDL, Very High Speed Integrated Circuit Hardware Description Language)模擬出我們所提出的架構。
It is very important that error correct coding for digital communication. RS code is even more popularly application on digital communication and storage medium as error correct coding algorithm and correct the error by channel. For bursty error and random error, RS code can provide excellent error correct capability. So it is used for channel coding usually.
This paper emphasizes on the part of decoder and bases on modified Euclidean algorithm to enter a concept of linear feedback shift register in it. When we use Euclidean algorithm to arithmetic, we often employ great common division to solve quotient and remainder with recursion continuously. It greatly makes use of the operation of addition and multiplication that result in decreasing the speed of calculation. If we use the architecture of LFSR, we could take place of multiplication by division and reduce the number of arithmetic unit to simplify circuit. After that we find the method of ridding of timing control and check with c program. Finally, we simulate the produced architecture by VHDL.
誌謝…………………………………………………………………………………...ii
摘要…………………………………………………………………………………..iii
ABSTRACT………………………………………………………………………….iv
目錄…………………………………………………………………………………...v
表目錄 ……………………………………………………………………………….vii
圖目錄 ………………………………………………………………………………viii
辭彙、符號說明和縮寫……………………………………………….......................x
1. 緒論………………………………………………………………………………1
1.1 前言 1
1.2 編碼通訊簡介 2
1.3 編碼通訊的演進及類別 4
2. Galois Field 原理介紹…………………………………………………………..6
2.1 群及場 6
2.2 Galois Field 建構 11
2.2.1 Galois Field 基本性質 12
2.2.2 Galois Field 運算 13
2.2.3 Galois Field 向量空間 17
3. Reed-Solomon 碼理論…………………………………………………………19
3.1 原理探討 19
3.2 編碼 21
3.3 解碼 23
3.3.1歐幾里德演算法 27
3.3.2 LFSR 導入 33
4. 電路設計與模擬驗證…………………………………………………………..38
4.1 電路設計 38
4.1.1 加法 39
4.1.2 乘法 40
4.1.3 除法 42
4.1.4 餘式電路 43
4.1.5 RS code編碼器 45
4.1.6 Syndrome電路 47
4.2 模擬與驗證 48
4.2.1 解碼架構 48
4.2.2 軟體模擬驗證 49
5. 實驗結果與測試………………………………………………………………..50
5.1 實驗測試 50
5.1.1 RS code (7,3,5)測試 50
5.1.2 RS code (255,223,33)測試 54
5.2 程式燒錄 58
6. 結論與未來展望………………………………………………………………..59
6.1 結論 59
6.2 未來展望 59
參考文獻…………………………………………………………………………….60
自傳………………………………………………………………………………….62
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[17]CIC訓練課程,“FPGA Design with ISE Foundation”,國科會國家晶片系統設計中心,新竹,第13-14頁,2004。
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